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基於Quartz-SSTA的方法論支持晶格內變異、統計洩漏、最差情況提取以及統計優化 美國加利福尼亞州聖荷西市， 2007年6月25日訊—半導體設計軟體供應商捷碼（Magma）® 設計自動化有限公司（納斯達克股票交易代碼：LAVA）於今日發布了被用於台積電（TSMC）65奈米工藝過程的增強型統計靜態時序分析（SSTA）方法論， 該方法以捷碼公司的Quartz™ SSTA 為基礎而構建，進一步拓展了台積電設計參考流程7.0版所提供的功能。這一先進的方法目前支持在台積電設計參考流程8.0版中有效的全局（裸晶之間）以及隨機（晶格內）工藝偏差、複合電流源（CCS）模型、統計洩漏分析以及統計優化。此外，台積電目前向捷碼提供規則，以確保統計提取和最差情況的RC分析。雙方公司經過歷時近兩年的緊密合作開發並驗証了這一方法論。所獲得的優勢包括降低的風險、改善的結果質量（QoR）、更加穩定優質的設計、更短的周轉周期以及簡化的大量簽核流程。 捷碼設計實施事業部總經理Kam Kittrell評價說：“捷碼的Quartz SSTA 與台積電的工藝過程技術緊密耦合在一起，實現了設計師所需要的精確度，同時解決了工藝和金屬偏差兩個問題，”他進一步強調道：“此外，捷碼的Quartz SSTA能夠完全整合到捷碼的積體電路（IC）實施流程中，賦予了物理實施引擎偏差意識。通過將這一功能強大的功能內置到流程中，改善了結果質量（QoR），同時加速並簡化了時序收斂和簽核。” 台積電設計服務市場副總監 Kuo Wu 表示道：“能夠解決工藝偏差的捷碼方法對於幫助設計師們進行65奈米及其以下節點的設計是非常有效的，”他繼續評論說：“與捷碼公司就統計靜態時序分析方法論的緊密協作結出了累累碩果，收獲了一個先進的方法，而且能夠緊密整合到設計流程中。” 關於統計時序分析方法論
而Quartz SSTA 以功能強大的、準確的統計靜態時序分析恰好補充了傳統簽核方法的不足。它利用隨機變量而不是固定延遲，生成統計學的分布，而不是最好情況和最差情況模型，因而能夠解決全局和隨機的工藝偏差、最差情況金屬偏差，並自動識別對偏差敏感的時鐘網絡、時序路徑、晶格以及金屬層。Quartz SSTA 利用統一數據模型架構，與捷碼的積體電路實施系統無縫地協同工作，自動地修正由於偏差引發的問題。通過有偏差意識的IC實施流程，設計的失敗傾向得以消除，可預測性得以增強，從而能夠更快、更輕鬆地完成時序收斂以及簽核。 關於捷碼（Magma） 捷碼(Magma) 為注冊商標，QuickCap和“從邏輯電路到矽片的最佳捷徑”是捷碼設計自動化有限公司的商標。所有其他的產品與公司名都是這些公司的商標與注冊商標。 前瞻性聲明：
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